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reg [3:0] r_cnt;
reg [14:0] r_sft;
reg [15:0] r_out;
assign L_WR = ^r_cnt[3]; ←この出力クロックで叩いてないよねバカなの？死ぬの
assign D = r_out;
always @(posedge P_SCK)←こうしろ
begin
if (P_CE0) begin
r_cnt <= 0;
end else begin
r_cnt <= r_cnt +1;
end
end
always @(posedge P_SCK)
begin
r_sft[13:0] <= r_sft[14:1];
r_sft[14] <= P_MOSI;
if (r_cnt == 15) begin
r_out[14:0] <= r_sft[14:0];
r_out[15] <= P_MOSI;
end
end
あとリセット信号ないから、糞
H8
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